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LCMXO2-256HC-4TG100C Originale è Novu Cù Prezzu Competitivu In Stock Fornitore IC

breve descrizzione:

U Dispositivu Logica Programmable Complex (CPLD) hè un Circuitu Integratu (ASIC) specificu per l'applicazione in u Circuitu Integratu LSI (Large Scale Integrated Circuit).Hè adattatu per u disignu di u sistema digitale intensivu di cuntrollu, è u so cuntrollu di ritardu hè convenientu.CPLD hè unu di i dispositi chì crescenu più veloce in circuiti integrati.
Cumpunenti di CPLD
CPLD hè un dispusitivu logica programmable cumplessu cù grande scala è struttura cumplessa, chì appartene à a gamma di circuiti integrati à grande scala.

 


Detail di u produttu

Tags di u produttu

Attributi di u produttu

Codice Pbfree
Codice Rohs
Part Life Cycle Code Attivu
U fabricatore LATTICE SEMICONDUCTOR CORP
Part Package Code QFP
Descrizzione di u pacchettu LFQFP,
Pin Count 100
Reach Compliance Code cunforme
Codice ECCN EAR99
Codice HTS 8542.39.00.01
Produttore Samacsys Lattice Semiconductor
Funzioni supplementari OPERATE ANCHE À 3.3 V SUPPLY NOMINAL
Codice JESD-30 S-PQFP-G100
Codice JESD-609 e3
Lunghezza 14 mm
Livellu di sensibilità à l'umidità 3
Numaru di inputs dedicati  
Numero di linee I/O  
Numaru di inputs 55
Numero di Outputs 55
Numero di Terminali 100
Temperature di funziunamentu-Max 85 °C
Temperature di funziunamentu-Min  
Urganisazione 0 INGRESSI DEDICATI, 0 I/O
Funzione di output MIXTU
Materiale di u corpu di u pacchettu PLASTIQUE/EPOXY
Codice di u pacchettu LFQFP
Codice di equivalenza di u pacchettu TQFP100,.63SQ
Forma di pacchettu QUADRA
Stile di pacchettu FLATPACK, BASSU PROFILE, FINE PITCH
Metudu di imballaggio VASSETTA
Température de refusion maximale (Cel) 260
Forniture d'energia 2,5/3,3 V
Tipu logicu programmable FLASH PLD
Ritardo di propagazione 7,36 ns
Status di qualificazione Ùn hè micca qualificatu
Altezza seduta - Max 1,6 mm
Tensione di supply-Max 3.462 V
Tensione di supply-Min 2.375 V
Tensione di alimentazione-Nom 2,5 V
Munti superficia
Grade di temperatura ALTRE
Finitura di u terminal Tin Matte (Sn)
Forma terminale ALA DI GABELLA
Pitch terminal 0,5 mm
Posizione Terminal QUAD
Tempu @ Temperature di riflussu di punta-Max (s) 30
Larghezza 14 mm

 

 

Introduzione di u produttu

U Dispositivu Logica Programmable Complex (CPLD) hè un Circuitu Integratu (ASIC) specificu per l'applicazione in u Circuitu Integratu LSI (Large Scale Integrated Circuit).Hè adattatu per u disignu di u sistema digitale intensivu di cuntrollu, è u so cuntrollu di ritardu hè convenientu.CPLD hè unu di i dispositi chì crescenu più veloce in circuiti integrati.

Cumpunenti di CPLD

CPLD hè un dispositivu logicu programabile cumplessu cù una grande scala è una struttura cumplessa, chì appartene à a gamma di grande scala.circuiti integrati.

CPLD hà cinque parti principali: bloccu di array logicu, unità macro, termini di produttu allargatu, array cablatu programabile è bloccu di cuntrollu I / O.

1. Blocu di array logicu (LAB)

Un bloccu di array logicu hè custituitu da un array di 16 macrocellule, è parechji LABS sò cunnessi inseme da un array programmable (PIA) è un bus globale.

2. Macro unità

L'unità macro in a serie MAX7000 hè custituita da trè blocchi funziunali: una matrice logica, una matrice di selezzione di produttu, è un registru programmabile.

3. Terminu di u produttu allargatu

Un termu di produttu di ogni macro cellula pò esse mandatu inversamente à l'array logicu.

4. Array wired programmable PIA

Ogni LAB pò esse cunnessu per furmà a logica necessaria à traversu l'array cablatu programabile.Stu busu glubale hè un canale programmable chì pò cunnette ogni fonte di signale in u dispusitivu à u so destinazione.

5. I / O bloccu cuntrollu

U bloccu di cuntrollu I/O permette à ogni pin I/O per esse cunfiguratu individualmente per input/output è operazione bidirezionale.

Comparazione di CPLD è FPGA

Ancu se i duiFPGAèCPLDsò dispusitivi ASIC programabili è anu parechje caratteristiche cumuni, per via di e differenze in a struttura di CPLD è FPGA, anu e so caratteristiche:

1.CPLD hè più adattatu per cumplettà diversi algoritmi è logica cumminatoria, è FP GA hè più adattatu per cumplettà a logica sequenziale.In altre parolle, FPGA hè più adattatu per a struttura ricca di flip-flop, mentre chì CPLD hè più adattatu per a struttura limitata di flip-flop è ricca di termini di produttu.

2.A struttura di routing cuntinuu di CPLD determina chì u so ritardu di timing hè uniforme è prevedibile, mentre chì a struttura di routing segmentatu di FPGA determina a so imprevisibilità di ritardu.

3.FPGA hà più flessibilità di CPLD in prugrammazione.CPLD hè programatu mudificà a funzione logica cù un circuitu di cunnessione internu fissu, mentre chì FPGA hè programatu cambiendu u filatu di a cunnessione interna.FP GA pò esse programatu sottu una porta logica, mentri CPLD hè programatu sottu un bloccu logicu.

4.L'integrazione di FPGA hè più altu ch'è di CPLD, è hà una struttura di cablaggio più cumplessa è implementazione logica.

5.CPLD hè più còmuda d'utilizà cà FPGA.Programmazione CPLD cù a tecnulugia E2PROM o FASTFLASH, senza chip di memoria esterna, faciule d'utilizà.Tuttavia, l'infurmazione di prugrammazione di FPGA deve esse guardata in memoria esterna, è u metudu di usu hè cumplicatu.

6. I CPLDS sò più veloci di FPgas è anu più prevedibilità di u tempu.Questu hè chì i FPGas sò una prugrammazione à livellu di porta è l'interconnessioni distribuite sò aduttate trà CLBS, mentri CPLDS sò una prugrammazione à livellu di bloccu logicu è l'interconnessioni trà i so blocchi logici sò lumped.

7.In u modu di prugrammazione, CPLD hè principalmente basatu annantu à a prugrammazione di memoria E2PROM o FLASH, i tempi di prugrammazione finu à 10.000 volte, u vantaghju hè chì u putere di u sistema ùn hè micca persu l'infurmazioni di prugrammazione.CPLD pò esse divisu in duie categurie: prugrammazione nantu à u programatore è prugrammazione in u sistema.A maiò parte di l'FPGA hè basatu annantu à a prugrammazione SRAM, l'infurmazione di prugrammazione hè persa quandu u sistema hè spenta, è a dati di prugrammazione deve esse scritte à a SRAM da fora di u dispusitivu ogni volta chì hè alimentatu.U so vantaghju hè chì pò esse programatu in ogni mumentu, è pò esse programatu rapidamente in u travagliu, per ottene una cunfigurazione dinamica à u livellu di u pianu è u livellu di u sistema.

8. A cunfidenziale CPLD hè bona, a cunfidenziale FPGA hè povera.

9.In generale, u cunsumu di energia di CPLD hè più grande di quellu di FPGA, è u più altu u gradu di integrazione, u più evidenti.


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