10AX048H2F34E2SG 100% Novu è Originale Propiu Stock Circuit integratu High Performance Clock Buffer Family

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breve descrizzione:

A famiglia di dispositivi Arria 10 offre un rendimentu più altu ch'è a generazione precedente di FPGA mid-range è high-end è offre una alta efficienza ottenuta attraversu un set cumpletu di tecnulugia di risparmiu di energia.I dispositi Arria 10 sò ideali per l'applicazioni midrange d'alta prestazione, sensibili à u putere in diversi mercati.

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Detail di u produttu

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Attributi di u produttu

UE RoHS	Conforme
ECCN (US)	3A001.a.7.b
Status di parte	Attivu
HTS	8542.39.00.01
Automotive	No
PPAP	No
Nome di famiglia	Arria® 10 GX
Tecnulugia di prucessu	20 nm
I/O d'utilizatori	492
Numero di Registri	727160
Tensione di alimentazione operativa (V)	0,9
Elementi logici	480000
Numero di multiplicatori	2736 (18 x 19)
Tipu di memoria di prugramma	SRAM
Memoria integrata (Kbit)	28760
U numeru tutale di blocchi RAM	1438
EMACs	3
Unità logica di u dispusitivu	480000
Dispositivu Numeru di DLL / PLL	12
Canali Transceiver	36
Velocità di transceiver (Gbps)	17.4
DSP dedicatu	1368
PCIe	2
Programmabilità	Iè
Supportu di riprogrammabilità	Iè
Prutezzione di copia	Iè
Programmabilità in u sistema	Iè
Grade di velocità	2
Standard di I/O unicu	LVTTL \| LVCMOS
Interfaccia di memoria esterna	DDR3 SDRAM\|DDR4\|LPDDR3\|RLDRAM II\|RLDRAM III\|QDRII+SRAM
Tensione d'alimentazione minima di u funziunamentu (V)	0,87
Tensione massima di alimentazione operativa (V)	0,93
Tensione I/O (V)	1.2\|1.25\|1.35\|1.5\|1.8\|2.5\|3
Température minimale de fonctionnement (°C)	0
Température maximale de fonctionnement (°C)	100
Grade di temperatura di u fornitore	Stendu
Nome cummerciale	Arria
Muntà	Munti superficia
Altezza di u pacchettu	2.8
Larghezza di u pacchettu	35
Lunghezza di u pacchettu	35
PCB cambiatu	1152
Nome di u pacchettu standard	BGA
Pacchettu Supplier	FBGA
Pin Count	1152
Forma di piombo	Ballu

Introduzione di u produttu

I dispositi Intel Arria 10 utilizanu un ALM 20 nm cum'è u bloccu di basa di u tessulu logicu.L'architettura ALM hè listessa cum'è l'FPGA di a generazione precedente, chì permette una implementazione efficiente di funzioni logiche è una cunversione faciule di IP trà e generazioni di u dispositivu.L'ALM utilizza una tabella di ricerca fratturabile (LUT) di 8 ingressi cù quattru registri dedicati per aiutà à migliurà a chiusura di u timing in disinni ricchi di registru è ottene una capacità di imballaggio di cuncepimentu ancu più altu ch'è u tradiziunale di dui registri per l'architettura LUT.